[Suzaku:01521] Re: Starter Kit Guideを参考にしたEDK上でのプログラミングについて

[Ken-ichiro Ishikawa]

石川です。

中島さん、勝村さん。ご回答ありがとうございます。
返事が遅れてすいません。

　結局、中島さんがおっしゃったとおりに
EDKをISEのサブモジュールとして読み込む方法で乗り切りました。

　アドバイスありがとうございました。

2009/06/15 17:45 mio <email@hidden>:
>
> 中島です。
>
> > 石川です。
> >
> > 連投すいません。
> >
> >
> > XPSで自作のVerilogのプログラムを組み込んだシステムの開発をしようとしています。
> > Starter Kitの１１章を参考に自分のプログラムに合わせながら開発をしています。
> >
> > 色々やってみたところVerilogのプログラムをコンパイルしてくれないため、
> > インターフェイス部になっているVHDLのプログラムのコンパイル時に
> > top_circuit is not an entity name
> > というエラーが出てしまっているようです(top_circuitはVerilogのプログラムのモジュール名）。
> >
> > やったことは
> > １．
> > E:\TimeSynchronization\sz310-add_slot-20071214\pcores\opb_sil00_v1_01_c\data
> > の
> > opb_sil00_v2_1_0.mpd
> > の記述を
> > OPTION HDL = MIXED
> > に変更。
> >
> > ２．
> > E:\TimeSynchronization\sz310-add_slot-20071214\pcores\opb_sil00_v1_01_c\hdl\verilog
> > の下に
> > top_circuit.v
> > sync.v
> > を置く(両プログラムが自作のVerilogプログラム)。
> >
> > ３．
> > E:\TimeSynchronization\sz310-add_slot-20071214\pcores\opb_sil00_v1_01_c\data
> > の
> > opb_sil00_v2_1_0.pao
> > に
> > lib opb_sil00_v1_01_c top_circuit verilog
> > lib opb_sil00_v1_01_c sync verilog
> > lib opb_sil00_v1_01_c user_logic vhdl
> > lib opb_sil00_v1_01_c opb_sil00 vhdl
> > を追加。
> >
> > ４．
> > user_logic.vhdのプログラムを変更し、topp_circuitと接続。
> >
> > です。
> >
> > E:\TimeSynchronization\sz310-add_slot-20071214\synthesis
> > の
> > opb_sil00_0_wrapper_xst.srp
> > を読む限り、
> > top_circuitやsyncのコンパイルはされずに飛ばされてuser_logicのコンパイルに移ってしまっているようです。
> >
> > 他にやらなければならないことがあったら指摘してください。
> > よろしくお願いします。
> >
> ぱっとみたところ、何も思い浮かびません・・・。
>
> 手元に8.2iがないので、8.2iに入っているIPコアかどうか確認できないのですが、
> jtagppc_cntlrなどは、vhdlとverilogで構成されているIPコアなので、
> 構成をみてみると、何か手がかりになるかもしれません。
> jtagppc_cntlrのIPコアは以下にあります。
> EDKのインストールフォルダ\hw\XilinxProcessorIPLib\pcores\jtagppc_cntlr_v1_00_b
>
> あまりにツールに踊らされるのも何なので、
> IPコアにすることにこだわりがなければ、
> EDKをISEのサブモジュールとしてよみこんでしまったほうが、
> コンパイルされないとか、そんなことに悩まされなくて良いかもしれません。
> 詳細につきましては、スターターキットガイドの12.1章をご参照お願いします。
>
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